$2,500
74LS92
El 74LS92 es un contador divisor entre 12 que contiene cuatro flip-flops maestro-esclavo y compuerta adicional para proporcionar un contador de división por dos y un contador binario de 3 etapas para el cual la duración del ciclo de recuento es dividida por cinco para la división por seis para el LS92. Este contador tiene un reinicio cero cerrado para uso en aplicaciones complementarias de BCD nines. Para usar su longitud máxima de conteo de este contador, la entrada CKB está conectada a la salida QA. Los pulsos de conteo de entrada se aplican a la entrada CKA y las salidas son como se describe en la tabla de funciones apropiada.
Especificaciones:
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| 74LS92 TTL Eliminar | 74LS139 TTL Eliminar | 74LS32 TTL Eliminar | 74LS253 TTL Eliminar | 74LS164 TTL Eliminar | 74LS125 TTL Eliminar | |
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| Name | 74LS92 TTL Eliminar | 74LS139 TTL Eliminar | 74LS32 TTL Eliminar | 74LS253 TTL Eliminar | 74LS164 TTL Eliminar | 74LS125 TTL Eliminar |
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| Price | $2,500 | $2,500 | $2,200 | $2,500 | $2,000 | $2,500 |
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| Availability | ||||||
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| Description | 74LS92 El 74LS92 es un contador divisor entre 12 que contiene cuatro flip-flops maestro-esclavo y compuerta adicional para proporcionar un contador de división por dos y un contador binario de 3 etapas para el cual la duración del ciclo de recuento es dividida por cinco para la división por seis para el LS92. Este contador tiene un reinicio cero cerrado para uso en aplicaciones complementarias de BCD nines. Para usar su longitud máxima de conteo de este contador, la entrada CKB está conectada a la salida QA. Los pulsos de conteo de entrada se aplican a la entrada CKA y las salidas son como se describe en la tabla de funciones apropiada.
| 74LS139 TTL El 74LS139 Decodificador y Demultiplexor TTL es un circuito integrado dual de 2 a 4 líneas, de alta velocidad fabricado con el proceso de diodo de barrera Schottky. El 74LS139 Decodificador y Demultiplexor TTL es útil para reemplazan varias funciones de puerta y reducir la cantidad de paquetes necesarios en una red lógica y usarse en decodificación de memoria de alto rendimiento o aplicaciones de enrutamiento de datos que requieren tiempos de retardo de propagación muy cortos. | 74LS32 TTL El 74LS32N es un circuito de compuerta lógica digital que implementa la disyunción lógica quad-2 de entrada positiva con 4 compuertas OR independientes y opera en un rango de tensión de alimentación de 4.75 a 5.25V. El 74LS32 es un circuito integrado de compuerta OR de cuatro entradas. Una compuerta OR tiene una o más entradas y una salida. Si al menos una de las entradas es 1, entonces la salida será 1. Si todas las entradas son 0, entonces la salida será 0. La 74LS32 es una compuerta OR de cuatro entradas, lo que significa que tiene cuatro entradas y una salida. Se utiliza para realizar la operación lógica OR en un circuito digital.Cuando todas sus entradas están en 0 (cero) o en BAJA, su salida está en 0 o en BAJA, mientras que cuando al menos una o ambas entradas están en 1 o en ALTA, su SALIDA va a estar en 1 o en ALTA. En otro sentido, la función de la compuerta OR efectivamente encuentra el máximo entre dos dígitos binarios, así como la función AND encuentra el mínimo. Se puede ver claramente que la salida X solamente es "0" (0 lógico, nivel bajo) cuando la entrada A como la entrada B están en "0". En otras palabras la salida X es igual a 0 cuando la entrada A y la entrada B son 0. Este dispositivo realiza la función booleana Y = A + B o Y = (A \ • B \) \ en lógica positiva. | 74LS253 TTL Dual 4 Input Multiplexer with 3 State Outputs Circuito integrado TTL 74LS253. Multiplexor doble de cuatro entradas con tres salidas cada una. | 74LS164 TTL Salida en Paralelo y Entrada en Serial 8 Bit Circuito Integrado TTL 74LS164. Registros de cambio de salida en paralelo y entrada en serial de 8 Bits y función de clear. Las entradas en serie(A y B) permiten un control completo sobre los datos entrantes. | 74LS125 TTL El SN74LS125 es una función cuádruple Bus Buffer de 3 estados que, cuando está activada, tiene las características de baja impedancia de una salida TTL con capacidad de accionamiento adicional a niveles lógicos altos para permitir la conducción de líneas de bus pesadamente cargadas sin resistencias externas pull-up. Cuando está desactivado, ambos transistores de salida se desactivan, presentando un estado de alta impedancia al bus, de modo que la salida no actuará ni como carga significativa ni como controlador. Las salidas del dispositivo LS125A se desactivan cuando G \ es alta. |
| Content | Especificaciones:
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| Weight | N/D | N/D | N/D | N/D | N/D | N/D |
| Dimensions | N/D | N/D | N/D | N/D | N/D | N/D |
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